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    4,676 verilog vhdl trabajados encontrados, precios en USD
    simulación Xilinx ISE Finalizado left

    Implementar, simular FFT en entorno xilinx o alguna plataforma similar , bajo la plataforma Atlys Spartan-6. Simular e implementar FFT en dicha plataforma, desarrollar código VHDL y detallar minuciosamente paso a paso, tomar captures y realizar documento de word detallando cada paso la oferta es de 90 usdt. Se cuenta con la tarjeta en físico por lo cual se ofrece conexión remota, ante cualquier duda estoy abierto a conversar

    FPGA Verilog / VHDL
    $180 (Avg Bid)
    $180 Oferta promedio
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    Descifrado verilog Finalizado left

    A partir del codigo de cisfrado, que facilito. Implementar el codigo para descifrado. Para ello se Implementará el algoritmo de descifrado y comprobarás su funcionamiento usando el mensaje cifrado como entrada y la clave operativa (MSBF). Si la simulación es correcta, el resultado será un bloque de 64 bits a cero (u ocho bytes a cero). A continuación, descrifrarás el mensaje cifrado que faciltaré con la clave operativa asociada. Y colocarás el mensaje en claro en la caja de texto de la tarea. Se proporcionará todos los archivos, claves en privado. Se necesita para el día 2 de Noviembre, es una tarea de estudios, fácil. El tiempo estimado de trabajo es 30 min porque el codigo de cisfrado lo tengo, solo es modif...

    Ingeniería eléctrica Electrónica FPGA Mathlab y Mathematica Verilog / VHDL
    $28 (Avg Bid)
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    Diseño de una RAM VHDL Finalizado left

    Diseño de circuito VHDL en vivado

    Ingeniería eléctrica Electrónica Ingeniería FPGA Verilog / VHDL
    $20 (Avg Bid)
    $20 Oferta promedio
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    TFG sobre Diseño de un periférico VHDL. Finalizado left

    Buenas! Veréis tengo que hacer el TFG, tengo casi hecho el código en VHDL, pero yo creo XILINX me vacila. Tengo que entregarlo antes de diciembre y necesito que alguien me lo consiga a hacer porque yo solo no lo saco. Adjunto las entidades que tengo hechas, esta casi todo ya escrito solo me falta que me funcione, que no se por que, pero no me funciona.

    Electrónica Ingeniería Verilog / VHDL
    $8 - $31
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    Diseño de contador/ Cronometro en VHDL/Vivado Finalizado left

    Requiero un contador / cronometro que pueda contar de 0 a 99.9 segs, se debera entregar codigo fuente en VHDL / Vivado asi como resultado de simulaciones

    Diseño de circuitos Ingeniería eléctrica Electrónica Diseño PCB Verilog / VHDL
    $25 (Avg Bid)
    $25 Oferta promedio
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    Project for Miguel Angel R. Finalizado left

    Hola Miguel Angel, dominas VHDL? Si es así creo este proyecto para hablar contigo más ya que tengo un requerimiento pequeñito para resolver. Seguimos hablando por aquí.

    Assembler Programación en C Programación en C++ Python Ensamblador x86/x64
    $8 (Avg Bid)
    $8 Oferta promedio
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    Project for Jorge Eduardo O. Finalizado left

    Hola Jorge Eduardo, como estamos? Dominas VHDL? Necesito un poco de ayuda con un pequeño proyecto. Seguimos hablando por aquí.

    ARM MySQL Ruby on Rails Swift Vue.js
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    $8 Oferta promedio
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    Project for Jorge Luis V. Finalizado left

    Hi Jorge Luis, necesito ayuda con una cuestión de VHDL bastante sencilla si fuera posible. hablame por aquí y concretamos. es un poco urgente

    Ingeniería eléctrica Ingeniería Mathlab y Mathematica Neural Networks Python
    $8 - $8
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    Filtro de 3 bandas en vhdl Finalizado left

    Implemente un sistema de ecualización en tiempo real de tres bandas (bajos, medios y altos) en el FPGA de xilixn. Desarrolle los tres filtros necesarios para el ecualizador, los puede establecer en matlab o labview. Una vez definidos los coeficientes del filtro impleméntelos en el FPGA (a través de Matlab, Laview o Multisim). Se establece un bonus de 4 puntos para el grupo que lo implemente en código VHDL.

    Ingeniería eléctrica Electrónica LabVIEW Mathlab y Mathematica Verilog / VHDL
    $179 (Avg Bid)
    $179 Oferta promedio
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    Diseño FPGAs en VHDL Finalizado left

    Proyecto enfocado al diseño VHDL sobre FPGAS. Desarrollo de código y de bancos de pruebas, verificación del funcionamiento y resolución de algunas cuestiones. Tiene que estar terminado para el día 17 de diciembre. Se adjunta toda la descripción de lo que hay que hacer, así como unas plantillas para las soluciones y algunos bancos de pruebas.

    Ingeniería eléctrica Electrónica FPGA Diseño PCB Verilog / VHDL
    $30 (Avg Bid)
    $30 Oferta promedio
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    Programacion en Verilog -- 2 Finalizado left

    El objetivo general del presente proyecto consiste en la realización, verificación funcional y validación experimental de un microcontrolador sencillo basado en un subconjunto de la arquitectura del juego de instrucciones del RISC-V. El microcontrolador debe ser descrito en SystemVerilog de modo que sea sintetizable y pueda ser implementado en una FPGA Cyclone IV de Altera. Su validación experimental se realizará en el laboratorio mediante una aplicación sencilla propuesta por cada grupo que haga uso de los recursos hardware disponibles en el módulo de test. El proyecto abarca por tanto los aspectos de verificación funcional, descripción de hardware empleando SystemVerilog, implementación de un sistema digital integrado ...

    Ingeniería eléctrica Electrónica Ingeniería Microcontrolador Verilog / VHDL
    $155 (Avg Bid)
    $155 Oferta promedio
    1 ofertas
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    Programacion en Verilog Finalizado left

    El objetivo general del presente proyecto consiste en la realización, verificación funcional y validación experimental de un microcontrolador sencillo basado en un subconjunto de la arquitectura del juego de instrucciones del RISC-V. El microcontrolador debe ser descrito en SystemVerilog de modo que sea sintetizable y pueda ser implementado en una FPGA Cyclone IV de Altera. Su validación experimental se realizará en el laboratorio mediante una aplicación sencilla propuesta por cada grupo que haga uso de los recursos hardware disponibles en el módulo de test. El proyecto abarca por tanto los aspectos de verificación funcional, descripción de hardware empleando SystemVerilog, implementación de un sistema digital integrado ...

    Ingeniería eléctrica Electrónica Ingeniería Microcontrolador Verilog / VHDL
    $206 (Avg Bid)
    $206 Oferta promedio
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    Reloj, cronometro y alarma en VHDL para Basys2 Finalizado left

    Necesito hacer un programa en VHDL de un reloj (formato 24hs), con cronometro y con alarma. Cuando cambio a cada uno. no se debe perder la cuenta de la hora, cronometro o la alarma seteada. El reloj, la alarma y el cronometro se debe poder cargar/modificar manualmente. Detención y reinicio del cronometro. Cuando la hora del alarma coincida con el clock, prender los (o algún) led. Se deberá implementar algún tipo de barrido multiplexado para el uso de los 4 dígitos “7 segmentos”.

    Ingeniería eléctrica Electrónica Ingeniería PLC y SCADA Verilog / VHDL
    $180 (Avg Bid)
    $180 Oferta promedio
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    diseño digital en verilog Finalizado left

    necesito transmitir datos numericos entre la fpga nexys 3 y el pc, usando protocolo uart por medio del puerto serial uart, comunicacion asincrona, el proyecto requiere que se lea un numero en binario tomado desde los switchs que trae la tarjeta y muestre el valor ingresado en form...fpga nexys 3 y el pc, usando protocolo uart por medio del puerto serial uart, comunicacion asincrona, el proyecto requiere que se lea un numero en binario tomado desde los switchs que trae la tarjeta y muestre el valor ingresado en formato decimal en el lcd 7 segmentos, adicional a eso que esta información sea transmitida via puerto uart al computador. los entregarles son el codigo hecho en verilog,( make file, archivos.v ) ademas de brindar una breve explicacion del trabajo realizado. hay un p...

    Diseño digital Ingeniería eléctrica Electrónica FPGA Verilog / VHDL
    $33 / hr (Avg Bid)
    $33 / hr Oferta promedio
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    FPGA, Microprocesadores 68k y PowerPC. Aviónica, equipos embarcados. Finalizado left

    Necesito para nuestro equipo de 15 ingenieros incorporar dos nuevos ingenieros con ilusión, cierta experiencia y conocimientos en VHDL/Verilog y microprocesadores. Es trabajo a tiempo completo y con estabilidad (2 años). Ubicación: Sevilla y Albacete. Uno en cada sitio.

    Electrónica Ingeniería Verilog / VHDL
    $19552 - $48880
    $19552 - $48880
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    Desarrollar software Finalizado left

    Modificaciones y rutinas extras para- gestión de dispositivos procesado de imágenes video / foto reducción de tiempo de procesado Ubicación Tres Cantos, Madrid Conocimientos de FPGAs / VHDL un plus trabajo a realizar en Abril 2017

    PHP Arquitectura de software
    $14 / hr (Avg Bid)
    $14 / hr Oferta promedio
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    Control PID lenguaje VHDL tarjeta Basys 2 Finalizado left

    Controlar la velocidad de un motor mediante PID usando encoder, en lenguaje VHDL para la tarjeta Basys 2 Spartan 3.

    Programación Verilog / VHDL
    $412 (Avg Bid)
    $412 Oferta promedio
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    Programar VHDL Basys 2 Finalizado left

    Ascensor 4 pisos, mediante una targeta basys 2 en una spartan 3e

    Verilog / VHDL
    $145 (Avg Bid)
    $145 Oferta promedio
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    Manual tecnico para el arranque tarjeta nexys 2 vhdl con spartan 3E Finalizado left

    necesito realizar proyectos en la tarjeta Nexys 2 vhdl del fabricante que tiene el procesador spartan 3E de xilinx practicamente lo que busco es un manual tecnico de como descargar los softwares necesarios para el trabajo, describir paso a paso de como realizar un programa utilizando el puerto vga de la tarjeta , en concreto un programa completo basado VHDL que me permita con este programa piloto modificarlo para generar otros programas  basados en el puerto VGA  

    Ingeniería industrial Palm Programación Arquitectura de software Desarrollo de software
    $146 (Avg Bid)
    $146 Oferta promedio
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    programador vhdl para tarea dificultad media-baja. Remunerada y muy urgente Finalizado left

    Realiza un circuito básico de PWM donde el tiempo en alto pueda modificarse en pasos de 10%. Simula el circuito y comprueba su funcionamiento. Deben verse varias consignas, compronado que la anchura de la salida es la correcta. Para este apartado puedes realizar una compilación funcional. ? Cambiando el tipo de compilación a no-funcional, compila el diseño eligiendo el dispositivo FLEX10KRC240-2. Utiliza las herramientas de MaxPlusII para obtener la frecuencia máxima de trabajo a la que puede funcionar el sistema. Mirando la información que aparece en el report file (fichero .rpt), indica el porcentaje de recursos lógicos que ocupa tu diseño. ? Escribe los resultados en un documento y mándaselo al profesor, junto con un archivo...

    Programación en C Programación en C++ FPGA LabVIEW Verilog / VHDL
    $244 (Avg Bid)
    $244 Oferta promedio
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    TAREA FACIL VHDL REMUNERADA , 606411904, 620623276 Finalizado left

    Particular busca urgente programador para tarea REMUNERADA en vhdl (facililla). Se trata de una práctica de 3º de telecomunicaciones para entregar en 10 días. Texto tarea: Realiza un circuito básico de PWM donde el tiempo en alto pueda modificarse en pasos de 10%. Simula el circuito y comprueba su funcionamiento. Deben verse varias consignas, compronado que la anchura de la salida es la correcta. Para este apartado puedes realizar una compilación funcional. ● Cambiando el tipo de compilación a no-funcional, compila el diseño eligiendo el dispositivo FLEX10KRC240-2. Utiliza las herramientas de MaxPlusII para obtener la frecuencia máxima de trabajo a la que puede funcionar el sistema. Mirando la información que apar...

    Arquitectura de software Verilog / VHDL
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    Programar un juego VHDL Finalizado left

    Soy de colombia Programar un juego llamado simon dice En VHDL y en el programa llamado Xilinx Simón dice Colores  El juego Simón dice colores es un juego de memoria donde el jugador deberá seguir la secuencia de colores que “Simón”  aleatoriamente va generando.  cada uno asociado con un color (verde, amarillo, azul y  rojo). Cada acierto de la secuencia completa de colores por parte del jugador incrementa el nivel y Simón agrega un nuevo  color a la secuencia. El juego termina cuando el jugador se equivoque o cuando alcance el número máximo de niveles para  los que fue diseñado el juego, el cual en ningún caso deberá ser menor a 32 niveles. 

    Programación en C Programación en C++ FPGA LabVIEW Verilog / VHDL
    $244 (Avg Bid)
    $244 Oferta promedio
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    Technical expert (Xilinx Vivado) 4 días left

    We are Hiring Technical expert (Xilinx Vivado) Position: Academic Technical expert Freelancer Experience: 2+ years Qualification: Masters or Doctorate in Electronics & Communication Engineering Skills Required: Turbo Decoder VLSI Xilinx Vivado FPGA Verilog Machine learning Specific area: Need a Verilog, Xilinx Vivado and Machine learning expert Time: Part-time/Freelance Job Description: Require a Freelancer, who can do coding will be done on Xilinx Vivado. Implementation will be done on FPGA using Verilog/ system Verilog language

    FPGA Machine Learning (ML) Verilog / VHDL Very-large-scale integration (VLSI)
    $330 (Avg Bid)
    $330 Oferta promedio
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    SoC FPGA developer 3 días left
    VERIFICADO

    Looking for FPGA Developer who has experience in VHDL on SoC FPGA architecture

    FPGA FPGA Coding Verilog / VHDL
    $136 (Avg Bid)
    $136 Oferta promedio
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    SytemVerilog 2 días left

    System verilog information provided in the doc file

    Ingeniería eléctrica FPGA Verilog / VHDL
    $116 (Avg Bid)
    $116 Oferta promedio
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    LIN Bus controller FPGA 1 día left
    VERIFICADO

    I’m looking for a talented freelancer to help me design a LIN Bus controller FPGA, in VHDL. To be considered for the job, candidates should include past work in their application and provide relevant experience related to this project. Any working code previously developed is a plus. Deadline for the delivery 20th April 2023. A quotation is required, together with the proof of previous expertise of the working code already developed It will be required to 1. deliver VHDL source code for LIN master bus controller 2. testbench with a Verification module, or any other sort of mechanism to emulate a node 3. Integration and testing of a simple test code on hardware provided by us 4. documentation

    Automovilística Electrónica FPGA Verilog / VHDL
    $1290 (Avg Bid)
    $1290 Oferta promedio
    23 ofertas
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    SOC technology porting engineer Finalizado left

    Europe, Italy timezone preferred. Lead the activity for porting FPGA design to Silicon technology (memory replacement, ...) Carry on simulations of the updated RTL design to check that the functionality remains unchanged Execute static and formal verification of...check that the functionality remains unchanged Execute static and formal verification of RTL code using appropriate tools Run trial synthesis on the RTL design and check the timing violations Lead the activities for SoC sub-block Static Timing Analysis. Required Skills (expert): VHDL language Digital ASIC design flow Use of digital simulations with standard industry simulators (Mentor QuestaCore) Static and formal RTL verification (e.g. Synopsys Spyglass) Synthesis tools (e.g. Cadence Genus) UVM and System Verilog...

    ASIC Ingeniería eléctrica Electrónica Verilog / VHDL
    $19 - $38 / hr
    Sellado Acuerdo de Confidencialidad
    $19 - $38 / hr
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    IP Integrator with Basys 3 Digilent Finalizado left

    Program the Basys 3 using the Cordic IP Integrator to generate: the hyperbolic sine and hyperbolic cosine of an angle parameters: You must enter the angle in degrees using the switches, so that the vhdl code includes its respective conversion to radians. This angle should be shown on the 7 segment displays. Pressing btnu the displays should then show the (hyperbolic sine) of the entered angle, and pressing btnd should show the (hyperbolic sine) of the angle.

    Electrónica FPGA Microcontrolador Verilog / VHDL
    $30 (Avg Bid)
    $30 Oferta promedio
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    VHDL Video Test Pattern generator Finalizado left

    The company is searching for external collaborators to design and test a Video test pattern generator in VHDL. The module shall be configurable for different pixel bit, num,ber of pixel per clock, different pattern generated, resolution, frame rate, colour format, video output sequence

    Electrónica Ingeniería FPGA Verilog / VHDL Video Processing
    $581 (Avg Bid)
    $581 Oferta promedio
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    Sound Detection Sensor to turn on LED on FPGA DE1 SoC Board Cyclone V Finalizado left

    Hi, can you help me out to code Verilog coding for the sound detection sensor for turning on the LED on DE1 SoC Cyclone V board?

    Arduino Ingeniería eléctrica FPGA Microcontrolador Verilog / VHDL
    $24 (Avg Bid)
    $24 Oferta promedio
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    Project for Ahmed K. Finalizado left

    Hi Ahmed K., I noticed your profile and would like to ask for help with debugging a verilog project. We can discuss any details over chat.

    Algoritmos Android inteligencia artificial Mathlab y Mathematica Redacción de investigaciones
    $50 (Avg Bid)
    $50 Oferta promedio
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    Project for Sardar Hasnain A. Finalizado left

    Hi Sardar Hasnain A., I noticed your profile and would like to ask for help debugging a verilog project on vivado. We can discuss any details over chat.

    Programación en C Ingeniería eléctrica Electrónica Ingeniería Microcontrolador
    $50 (Avg Bid)
    $50 Oferta promedio
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    FPGA iCE40 Finalizado left

    Optimalizace fázového závěsu, převod jednoduché sekvenční a kombinační logiky do VHDL....

    Ingeniería eléctrica FPGA Microcontrolador Verilog / VHDL
    $26 / hr (Avg Bid)
    $26 / hr Oferta promedio
    1 ofertas
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    VLSI Implementation of Turbo Coder for LTE using Verilog HDL Finalizado left

    Turbo codes are error correction codes that are widely used in communication codes exhibits high error correction capability as compared with other error correction codes. This paper proposes a Very Large Scale Integration (VLSI) architecture for the implementation of Turbo decoder. Soft-in-soft out decoders, interleavers and deinterleavers is used in the decoder side which employs Maximum-a-Posteriori (MAP) algorithm. The number of iterations required to decode the information bits being transmitted is reduced by the use of MAP algorithm. For the encoder part, this paper uses a system which contains two Recursive convolutional encoders along with pseudorandom interleaver in encoder Turbo encoding and decoding is done using Octave, Xilinx Vivado, Cadence system is implemented and synthe...

    Ingeniería eléctrica Electrónica FPGA Verilog / VHDL Very-large-scale integration (VLSI)
    $107 (Avg Bid)
    $107 Oferta promedio
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    Design and Simulation of Combinatorial and Sequential Digital Systems Using VHDL Behavioral Modeling and the Xilinx Vivado Design Suite Finalizado left

    1)Using VHDL and the Xilinx Vivado Tools, design and implement a 4-bit ALU whose functionality is compliant with the TTL MSI 74LS381A specifications. The design must use a VHDL behavioral modeling coding style and can include concurrent and sequential statement types. Source code modules must include liberal commenting to clarify and explain function and operation your code. 2) Create a test bench VHDL module and use the Vivado Simulator to test/verify proper operation of the ALU’s functions with all input data patterns specified in the 74LS381A functional table. Recommendation: to make comparison of simulated results to those listed in the functional table easier, apply the external stimulus input patterns in the same “row” order as inputs are listed...

    Programación en C Programación en C++ Electrónica Microcontrolador Verilog / VHDL
    $68 (Avg Bid)
    $68 Oferta promedio
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    Project for Hassan Shahid, digital design, vhdl Finalizado left

    Hi Hassan Shahid, I noticed your profile and would like to offer you my project. We can discuss any details over chat.

    Animación 3D Modelado 3D Programación en C# Electrónica PHP
    $600 (Avg Bid)
    $600 Oferta promedio
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    DO-254 Project VHDL Finalizado left

    DO-254 Project - Task - Lint and Code coverage

    Analog Electronics Digital Electronics FPGA FPGA Coding Verilog / VHDL
    $181 (Avg Bid)
    $181 Oferta promedio
    1 ofertas
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    Understanding of FPGA for a report Finalizado left

    I want someone who understands FPGA, Vivado, Verilog, VHDL etc for a report

    Ingeniería eléctrica Electrónica FPGA Microcontrolador Verilog / VHDL
    $73 (Avg Bid)
    $73 Oferta promedio
    6 ofertas
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    Image processing using vhdl in Max V board ( quartus) Finalizado left

    Image processing digital electronic system

    Ingeniería eléctrica Ingeniería FPGA Mathlab y Mathematica Verilog / VHDL
    $296 (Avg Bid)
    $296 Oferta promedio
    9 ofertas
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    I have multiple tasks for Electrical Engineers Finalizado left

    Hi, How are you doing. I am looking for electrical engineers to work on multiple tasks in following areas: • Embedded C Programming. • VHDL/Verilog, LABView/ Multisim/PSPICE • Network Simulator NS2/NS3 • Microcontroller like Arduino, Raspberry Pi, FPGA, AVR, PIC and STM32. • IDEs like Keil MDK V5, ATmel studio and MPLab XC8. • PLCs / SCADA • PCB Designing-Proteus, Eagle. • IOT Technologies like Ethernet, GSM GPRS. • HTTP Restful APIs connection for IOT Communications. I am looking for long term work relationship. New freelancers are warmly welcomed. Important Note: I need dedicated freelancers who strictly follow the deadline and give me good quality work without any plagiarism.

    Programación en C Ingeniería eléctrica Electrónica Microcontrolador Verilog / VHDL
    $149 (Avg Bid)
    $149 Oferta promedio
    42 ofertas
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    Implementation of Gradient Descent Optimization Algorithms on FPGA in Verilog language which is synthesizable. Finalizado left

    Hi Moaz Khaled Feriz K., I noticed your profile and would like to offer you my project. We can discuss any details over chat.

    Altera Quartus ASIC Digital ASIC Coding FPGA Verilog / VHDL
    $54 (Avg Bid)
    $54 Oferta promedio
    1 ofertas
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    fpga video processing pipeline. - 12/01/2023 17:14 EST Finalizado left

    ...generator, where scanline parameters are passed as input wires : scanline color, scanline thickness, scanline interval 5. output is overlayed by the bitmap OSD with the same resolution as output format Requirements : aside from the DDR memory interface, or PLL no vendor or encrypted IP blocks can be used, for example no Altera/Intel video pipeline. Everything must be in written verilog source code. Must include verilog testbench that will accept input picture(in any format) and produce resulting picture(in any format). suggested pipeline i/o ports: Sysclk, [23:0] RGBin, HSin,VSin,DEin, Clkin [23:0] RGBout, HSout, VSout, DEout, Clkout [31:0] parameters[0:...] (whatever count is required). all needed memory interfaces signals to the memory multiplexer. Any dev board an...

    Electrónica FPGA Verilog / VHDL
    $2000 (Avg Bid)
    Acuerdo de Confidencialidad
    $2000 Oferta promedio
    1 ofertas
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    face recognition Verilog- gate level model -- 2 Finalizado left

    we have to give input images for that it should create a eigen face by using eigen values and eigen vectors and compare it with the given image matching or not in verilog so that I wanted to implement in the FPGA board I want it in gate level model

    Algoritmos CUDA FPGA Mathlab y Mathematica Verilog / VHDL
    $141 (Avg Bid)
    $141 Oferta promedio
    5 ofertas
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    Expert on VHDL and FPGA (only expert required) -- 2 Finalizado left

    I am looking to hire an individual who really understand this subject. should be able to solve any problems related to this subject. communicate and be able to write good programming and simulation designs.

    Ingeniería eléctrica Ingeniería FPGA Mathlab y Mathematica Verilog / VHDL
    $140 (Avg Bid)
    $140 Oferta promedio
    17 ofertas
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    Verilog project for image de-hazing (using dark channel prior algorithm) Finalizado left

    ...create a verilog code for image dehazing. The image is converted into a text file using Matlab(all pixel values are converted into corresponding hexadecimal values). This text file is given as the input to the verilog program. First we need to find the minimum of RGB value of each pixel and create a matrix. Then we need to consider a small window/mask in the new matrix and find the minimum of that mask and sweep the mask through the entire new matrix to create the darkchannel image. Then by using the equations using the darkchannel prior algorithm we need to recreate a haze free image. (the output of the verilog code will be a text file and is recreated into an image using Matlab. I am attaching a reference paper. I just need to get the basic dehazing part fro...

    Ingeniería eléctrica FPGA FPGA Coding Image Processing Verilog / VHDL
    $106 (Avg Bid)
    $106 Oferta promedio
    6 ofertas
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    Aparat de cafea in VHDL Finalizado left

    Crearea unui aparat de cafea in VHDL(rulabil in programul Vivado) intr-un limbaj cat mai simplist indeplinind cerintele din documentul atasat.

    Digital Electronics Verilog / VHDL
    $8 (Avg Bid)
    $8 Oferta promedio
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    line following bot Finalizado left

    I need code for my bot who follow the given line using line sensor. this code should be written in verilog language and fpga cyclone 4 is used as board.

    FPGA FPGA Coding Microcontrolador Verilog / VHDL
    $14 (Avg Bid)
    $14 Oferta promedio
    4 ofertas
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    I need a verilog project- single image dehazing using dark channel prior Finalizado left

    dark channel prior basically computes the minimum of rgb values present in a single pixel and assigns that value to the pixels. Once that is done, a patch of pixels is taken and the minimum is taken after which all the pixels in that patch are assigned the new minimum value. The input is a hex file of coloumn form and output is another hex file

    Arquitectura de software Verilog / VHDL
    $100 (Avg Bid)
    $100 Oferta promedio
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    Trophy icon BTC FPGA Miner Challenge -- Best Hashrate, Lowest power per hash 18 días left

    ...poor FPGA BTC mining implementations, with excessively slow, power hungry designs. Researchers presented dozens of papers on how to make this better. This is your chance to get it right. Read this paper , then and look at their Verilog here to get a good understanding about state of the art FPGA BTC mining with verilog. Then apply that to YOUR FORK of the old standard in with an updated proxy for getwork. Clues follow to make FPGA BTC mining faster, smaller, and lower power, so that you will have REAL bragging rights for the fastest, smallest, lowest power FGPA miners. 1) The SHA256 compression

    Ingeniería eléctrica FPGA Raspberry Pi Verilog / VHDL
    $840 (Avg Bid)
    Destacado Garantizado Sellado Concurso principal
    $840
    18 participaciones
    Ingresa ahora
    INTERVIEW PREPARATION GUIDE ! Finalizado left

    I am a verification engineer in Bangalore India, and preparing for Top Semiconductor Companies Interview Process like INTEL, NVIDIA , GOOGLE , Qualcomm, NXP Semiconductors , SAMSUNG and many more etc. So I am looking for a verification expert ...showcase me your skills . So that after gaining knowledge with your help I can crack any company interviews . I want all types of problem solving questions to be covered including puzzles as well . Kindly ping me here if you help me out with above . Kindly provide all types of possible questions which a company can ask in a interview , I need a kind of Question Bank. Mandatory Skills : Verilog , System Verilog, UVM , Functional Coverage , Code Coverage , Assertions , Constraints , Digital Electronics and FSM problem Solving questi...

    Electrónica Verilog / VHDL
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